云脉芯联
岗位职责： · 负责Linux驱动软件（网络协议栈、DPDK等）性能调优 · 结合云网络、云存储、AI等应用场景，完成Linux驱动软件适配、新特性开发及原型验证
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岗位职责： · 负责DPU SPDK存储卸载的方案设计及软件开发、性能优化 · 负责智能网卡基于TCP、RDMA的SPDK存储协议栈适配
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岗位职责： · 负责逻辑综合、LEC、ECO流程开发和质量把控。协助前端设计团队创建时序约束，完成时序收敛 · 负责全芯片STA流程执行、时序约束质量把控。协同后端团队完成Timing signoff
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职位描述： 1. 负责数字芯片微架构设计、性能分析、RTL实现、逻辑综合、设计交付质量把控； 2. 支持验证团队完成验证计划制定、验证问题定位、验证覆盖率分析。 职位要求： 1. 计算机、电子、通信相关专业本科及以上学历； 2. 掌握Verilog语言，了解SystemVerilog，熟悉ASIC或FPGA前端设计开发工具； 3. 有以下任意一项相关经验者优先： · 网络（Ethernet、TCP/IP、交换、路由） · 存储（NVMe、RDMA、RoCE） · PCIe、VirtIO、DMA · DDR、HBM 线上简历投递：hr2023@yunsilicon.com
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职位描述： 1. 负责模块级到芯片级的验证环境搭建、验证方案制定、验证计划执行； 2. 支持芯片原型验证、驱动软件开发、软硬件系统联调。 职位要求： 1. 计算机、电子、通信相关专业本科及以上学历； 2. 3年以上ASIC或FPGA数字前端设计或验证经验； 3. 熟悉SystemVerilog语言和UVM验证方法学，有C、Perl、或Python编程经验优先； 4. 有以下任意一项相关经验者优先： · 网络（Ethernet、TCP/IP、交换、路由） · 存储（NVMe、RDMA、RoCE） · PCIe、VirtIO、DMA · DDR、HBM 线上简历投递：hr2023@yunsili…
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职位描述： 1. 负责逻辑综合、LEC、ECO流程开发和质量把控。协助前端设计团队创建时序约束，完成时序收敛； 2. 负责全芯片STA流程执行、时序约束质量把控。协同后端团队完成Timing signoff。 职位要求： 1. 计算机、电子、通信相关专业本科及以上学历； 2. 精通SDC，熟练使用DC、Formality、PT，熟悉Tcl编程。 线上简历投递：hr2023@yunsilicon.com
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岗位职责： 1. 负责DPU及智能网卡Kernel-OvS研发及不同内核版本适配； 2. 推动云脉芯联DPU及智能网卡Kernel-OvS开源。
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岗位职责： 1. 推动云脉芯联DPU及智能网卡内核驱动代码进入内核开源社区； 2. 负责与内核开源社区的对接工作，包括社区合作、技术交流等； 3. 负责驱动和不同内核版本的适配方案设计及实现。